七路抢答器.doc

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电子课程设计实验报告

名称:七路抢答器

专业:电气工程与自动化

学号: 1229402043

七路抢答器

姓名:翟佳炜

目录

一、
前言......................................................................................
..........2
二、
设计内容与要求..................................................................
..........3
三、
设计思想和原理..................................................................
..........4
3.1 总体设计方案..................................................................... ..........4
3.1.1
设计思路..................................................................
..........4
3.1.2
设计框图..................................................................
..........5
3.2 单元电路设计..................................................................... ..........5
3.2.1
抢答部分..................................................................
..........5
3.2.2
定时部分..................................................................
..........9
四、芯片管脚图和真值表............................................................ ........13
五、心得与体会............................................................................ ........19
六、实物图………………………………………………………………… ……21
七、附录
1
,
、
元
器
件
清
单………………………………………………………………24
2、电路原理图.......................................................................... ........25
3、PCB板图与工艺图............................................................... .......26

七路抢答器

一、前言

在本次课程设计中,将主要设计一个供七人使用的定时抢答 器。主要实现以下功能:(1)为7位参赛选手各提供一个抢答按 钮,分别编号S1、S2、S3、S4、S5、S6、S7;(2)主持人可以控制 系统的清零与抢答开始;(3)抢答器要有数据锁存与显示的功能。 抢答开始后,若有任何一名选手按动抢答按钮,则要显示其编号至 系统被主持人清零,同时其他人再按对应按钮无效;(4)抢答器要 有自动定时功能,当主持人启动“开始”键后,定时器自动减计时, 并在显示器上显示;(5)参赛选手只有在设定时间内抢答方为有效 抢答。若抢答有效,则定时器停止工作,并且显示抢答开始时间直 到系统被清零;(6)若设定时间内无选手进行抢答(按对应按 钮),则系统禁止选手超时抢答;(7)优先编码电路、锁存器、译 码电路将参赛队的输入信号在显示器上输出。

数字抢答器由主体电路与扩展电路组成,优先编码电路、锁存

七路抢答器

器、译码电路将选手的输入信号在显示器上输出;用控制电路和主 持人开关启动电路,以上两部分组成主体电路。经过布线、焊接、 调试等工作后数字抢答器成形。

二、设计内容与要求

设计目的:

通过本课程设计,掌握数字电路系统的设计方法。

基本功能:
  1. 设计一个智力抢答器,可同时供7名选手参加比赛,对应7个抢答按钮。

  2. 主持人设置一个控制开关,用来控制系统的清零(显示数码管灭)和抢答开 始。

  3. 抢答器具有数据所存功能,抢答开始后,若有选手抢答,编号立即锁存, LED显示选手编号,并封锁输入电路。

  4. 参赛选手在设定的时间(9秒倒计时)内抢答,抢答有效,定时器停止工 作,显示选手编号和抢答时刻的时间,并保持到主持人将系统清零为止。

  5. 如果定时抢答的时间已到,却没有选手抢答,本次抢答无效,并封锁输入电

七路抢答器

路,禁止超时抢答。

扩展功能:
  1. 扬声器给出抢答音响提示或报警提示。

  2. 延长抢答时间(如30秒倒计时)。

  3. 主持人设定抢答时间,启动开始后,定时器立即减计时,并用显示器显示。

三、设计思想和原理

  • 3.1 总体设计方案
3.1.1 设计思路

①主持人按下复位按钮后,控制电路对编码电路、锁存电路控制使抢答器

七路抢答器

允许输入,使之处于等待状态。

②当有人抢答时,信号通过按钮送到编码电路,编码电路通过编码把结果 送入锁存电路锁存,锁存电路把结果又传给译码电路,译码电路把送来的信号 译码驱动显示电路,显示出抢答者的组号。

③在优先抢答者按钮的同时控制电路通过对编码电路和锁存电路的使能控 制使别的抢答者再按钮时失去作用,实现第一抢答信号得鉴别和锁存功能。

接通电源后,主持人将开关拨到"清零"状态,抢答器处于禁止状态,编号 显示器灭灯,定时器显示设定时间;主持人将开关置"开始"状态,宣布"开始" 抢答器工作。定时器倒计时,选手在定时时间内抢答时,抢答器完成——优先判 断、编号锁存、编号显示。当一轮抢答之后,定时器停止、禁止二次抢答、定 时器显示剩余时间。如果再次抢答必须由主持人再次操作"清除"和"开始"状态 开关。

3.1.2 设计框图

七路抢答器

锁存器
抢答按钮 优先编码 译码电路 显示电路
电路
主持人 控制电路
按钮
秒脉冲信号 定时电路 译码电路 显示电路
发生电路

3.2 单元电路设计

3.2.1 抢答部分

此部分电路主要完成的功能是实现7路选手抢答并进行锁存,同时有相应发 光二极管点亮和数码显示。

使用优先编码器74LS148 和锁存器74LS279 来完成。该电路主要完成两 个功能:一是分辨出选手按键的先后,并锁存优先抢答者的编号,同时译码显 示电

七路抢答器

路显示编号(显示电路采用七段数字数码显示管);二是禁止其他选手按键, 其按键操作无效。

编码部分主要由芯片74LS148优先编码器完成。它对由按钮送来的信号进行 优先编码,并输出结果。以下是对74LS148的介绍:

74LS148的输入端和输出端为低电平有效。0—7是输入信号,A2A1A0为三位 二进制编码输出信号。EI为使能输入端,当EI=1时,编码器禁止编码,当EI= 0时,允许编码。EO是使能输出端,只有在EO=0,而0—7均无编码输入信号时为 0。GS为优先编码输出端,在GS=0而0—7的其中之一有信号时,GS=0。0—7各输 入端的优先顺序为:7的级别最高,0的级别最低。如果7端输入为0(有信 号),则其它输入端即使有输入信号,均不起作用,此时输出只按7端编码, A2A1A0=000。

本设计中位七路抢答,0端应接高电平或悬空,这样才会对其他路抢答没有 影响。1—7分别接到7个选手按钮,当某路选手最先按下抢答按钮,即该路输入 低电平,且比它优先级别高的输入端无低电平输入时,输出端才输出相对应的 输入端代码。如按下S3,且优先级别比它高的4,5,6,7输入均为1时,输出代 码为100,这就是编码器的工作原理。

锁存部分用的是74LS279,以下是对它的介绍:

74LS279是由与非门构成的基本RS触发器,它有4种基本状态:

= 1 . 保持状态。当输入端接入 =1的电平时,如果基本SR触发器现态

=1、 =0,则触发器次态 =1、 =0;若基本SR触发器的现态 =0、 =1,则

触发器次态 =0、 =1。即 = =1时,触发器保持原状态不变。

2. 置0状态。当 =1, =0时,如果基本SR触发器现态为 =1、 =0,因

七路抢答器

=0,会使 =1,而 =1与 =1共同作用使 端翻转为0;如果基本SR触发器

现态为 =0、 =1,同理会使 =0, =1。只要输入信号 =1, =0,无论基 本SR触发器的输出现态如何,均会使输出次态置为0态。

3. 置1状态。当 =0、 =1时,如果触发器现态为 =0、 =1,因 =0, 会使G1的输出端次态翻转为1,而 =1和 =1共同使G2的输出端 =0;同理当

=1、 =0,也会使触发器的次态输出为 =1、 =0;只要 =0、 =1,无论 触发器现态如何,均会将触发器置1。

当 =1、 =0,也会使触发器的次态输出为 =1、 =0;只要 =0、 =1,无论触发器现态如何,均会将触发器置1。

  1. 不定状态。当 = =0时,无论触发器的原状态如何,均会使 =1, =1。 当脉冲去掉后, 和 同时恢复高电平后,触发器的新状态要看G1 和G2两 =

个门翻转速度快慢,所以称 =0是不定状态,在实际电路中要避免此状 态出现。

基本RS触发器的逻辑图如图3-1所示:

图3-1 基本RS触发器

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